arXiv · cs.AI· Alexis Maras·· 3 天前AI 评分10
通过累加感知量化让 DNN 适应电压缩放引发的硬件误差
Adapting DNNs to Embrace Voltage Scaling Induced Errors via Accumulation-Aware Quantization
来源与原文
arXiv · cs.AI
作者：Alexis Maras
发布时间：（北京时间）
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https://arxiv.org/abs/2610.33824v1
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AI 导读
一项硬件-软件协同设计方法利用 systolic array 累加器中时序稳健位范围随电压-频率工作点变化的特性，提出累加感知训练，结合混合精度量化与非结构化剪枝，辅以 MSB 掩蔽、细粒度时钟门控和逐层动态频率缩放。在 2nm 工艺节点的低电压前沿运行时，该后布局架构相对标称电压实现节能 39%、energy-delay product 提升 23%，精度损失保持在 1% 以内。论文已被 ICCAD '26 接收。
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